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fpga写的分频器,直接把clk针脚电平输出,对比分频后的波
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昌维001
小吧主
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fpga写的分频器,直接把clk针脚电平输出,对比分频后的波形输出电平不一样(会先过冲到和原始clk峰值一样,然后又降低一点点,负半周期同样如此,如图所示)
而且输入clk的正弦波不是很圆润,顶端有宽度较大的毛刺。
输出也不是方波,电平上升和下降沿时间都和晶振正弦波的四分之一周期一样长,这是正常现象吗?还是因为我的fpga板子太垃圾了才这样?
示波器本身方波测试正常。均是在10x衰减系数档位测试的。
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分频系数设成几千试试
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